Page 18 - 數位邏輯設計升學寶典
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10     數位邏輯設計



                 老師引導 6

            Ϟᗫ PALePLAeSPLDeCPLD ʿ FPGA ʕdɨΐાࠑО٫ ፹Ⴌkc(A) PAL ၾ PLA ѩ
            ̙၈މɓ၇ᔊఊۨ PLD€SPLDjSimple PLDc(B) CPLD ͟εࡈዹͭٙᜌ፨ਜ෯€logic

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             解   C  (1)  SPLD(PAL、PLA)不支援線上燒錄(ISP,In System Program)的功能,只有 CPLD、FPGA
                       才支援。
                    (2) 就容量大小而言,FPGA > CPLD > SPLD。

                 學生練習 6.1


                   ɨΐ࿁׵̙೻όᜌ፨ʩ΁€Programmable Logic DeviceٙાࠑdО٫͍ᆽkc
                     A  PROM ၾ PAL ே̙ࠠል஝ྌdPLA ̥ঐ஝ྌɓϣc B  PROM ʕٙ AND ཛྷ৬ΐ
                    ၾ OR ཛྷ৬ΐѩމ̙஝ྌٙഐ࿴c C  PLA ʕٙ AND ཛྷ৬ΐމʔ̙஝ྌٙഐ࿴dOR

                    ཛྷ৬ΐމ̙஝ྌٙഐ࿴c D  PAL ʕٙ AND ཛྷ৬ΐމ̙஝ྌٙഐ࿴dOR ཛྷ৬ΐމ
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                    答




                 學生練習 6.2


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                    ᆽk  A  PROM މ AND ৬ΐʔ̙஝ྌdOR ৬ΐ̙஝ྌc B  PAL މ AND ৬ΐʔ̙
                    ஝ྌdOR ৬ΐ̙஝ྌc C  PLA މ AND ৬ΐʔ̙஝ྌdOR ৬ΐ̙஝ྌc D  PAL

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                    答

                                                                                      學生練習     6.1 (D)  6.2 (A)
                                                                                      答  案
                                                                                              詳解請掃章首 QR-code
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